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參數資料
型號: MC100EP445FAR2
廠商: ON SEMICONDUCTOR
元件分類: 通用總線功能
英文描述: 3.3V/5VECL 8-Bit Serial/Parallel Converter
中文描述: 100E SERIES, 8-BIT RIGHT SERIAL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PQFP32
封裝: LQFP-32
文件頁數: 12/16頁
文件大小: 115K
代理商: MC100EP445FAR2
MC10EP445, MC100EP445
http://onsemi.com
12
To allow the user to synchronize the output byte data
correctly, the start bit for conversion can be moved using the
SYNC input pin (pin 2). Asynchronously asserting the
SYNC pin will force the internal clock to swallow a clock
pulse, effectively shifting a bit from the Q
n
to the Q
n-1
output
as shown in Figure 9 and Figure 10. For CKSEL LOW, a
single pulse applied asynchronously for two consecutive
clock cycles shifts the start bit for conversion from Q
n
to
Q
n-1
. The bit is swallowed following the two clock cycle
pulse width of SYNC on the next triggering edge of
clock (either on the rising or the falling edge of the clock).
Each additional shift requires an additional pulse to be
applied to the SYNC pin. (See Figure 9)
Figure 9. Timing Diagram A. 1:8 Serial to Parallel Conversion with SYNC Pulse at CKSEL LOW
CLK
SINA
CKSEL
PCLK
SYNC
Q0
D0
D1
D2
D3
D4
D5 D6
D7
D8
D9 D10 D11 D12 D13 D14 D15 D16 D17 D18 D19 D20 D21 D22 D23 D24
Q1
Q2
Q3
Q4
Q5
Q6
Q7
D0
D9
D17
D1
D10
D18
D2
D11
D19
D3
D12
D20
D4
D13
D21
D5
D14
D22
D6
D15
D23
D7
D16
D24
1
2
2 Clock Cycles for SYNC
Next Triggering Edge of Clock
Bit D8 is Swallowed
相關PDF資料
PDF描述
MC10EP445FAR2 3.3V/5VECL 8-Bit Serial/Parallel Converter
MC100EPT23DR2 Dual Differential LVPECL to LVTTL Translator
MC100EPT23DR2G Dual Differential LVPECL to LVTTL Translator
MC100EPT23D Dual Differential LVPECL to LVTTL Translator
MC100EPT23DG Dual Differential LVPECL to LVTTL Translator
相關代理商/技術參數
參數描述
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