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參數資料
| 型號： | MC68331VFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | User’s Manual |
| 中文描述： | 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數： | 84/254頁 |
| 文件大小： | 1354K |
| 代理商： | MC68331VFC20 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁當前第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁
MOTOROLA
4-42
SYSTEM INTEGRATION MODULE
MC68331
USER’S MANUAL
4
4.6.5.2 Reset States of Pins Assigned to Other MCU Modules
As a rule, module pins that are assigned to general-purpose I/O ports go to active high-
impedance state following reset. Other pin states are determined by individual module
control register settings. Refer to sections concerning modules for details. However,
during power-up reset, module port pins may be in an indeterminate state for a short
period. Refer to
4.6.7 Power-On Reset
for more information.
4.6.6 Reset Timing
The RESET input must be asserted for a specified minimum period for reset to occur.
External RESET assertion can be delayed internally for a period equal to the longest
bus cycle time (or the bus monitor time-out period) in order to protect write cycles from
being aborted by reset. While RESET is asserted, SIM pins are either in an inactive,
high impedance state or are driven to their inactive states.
When an external device asserts RESET for the proper period, reset control logic
clocks the signal into an internal latch. The control logic drives the RESET pin low for
an additional 512 CLKOUT cycles after it detects that the RESET signal is no longer
being externally driven, to guarantee this length of reset to the entire system.
Table 4-18 SIM Pin Reset States
State While
RESET
Asserted
1
1
High-Z Output
High-Z Output
Disabled
Disabled
1
1
1
Output
1
Mode Select
Disabled
Disabled
Disabled
1
1
1
Disabled
Disabled
Mode Select
Disabled
Asserted
Disabled
Disabled
Mode Select
Pin State After RESET Released
Pin State
Mnemonic
Pin
Function
CS10
CS[9:6]
ADDR[18:0]
AS
AVEC
BERR
CSM
CSE
CS0
CLKOUT
CSBOOT
DATA[15:0]
DS
DSACK0
DSACK1
CS5
FC1
CS3
HALT
IRQ[7:1]
MODCLK
R/W
RESET
RMC
SIZ[1:0]
TSC
Pin
Function
ADDR23
ADDR[22:19]
ADDR[18:0]
PE5
PE2
BERR
BG
BGACK
BR
CLKOUT
CSBOOT
DATA[15:0]
PE4
PE0
PE1
FC2
FC1
FC0
HALT
PF[7:1]
PF0
R/W
RESET
PE3
PE[7:6]
TSC
Pin State
CS10/ADDR23
CS[9:6]/ADDR[22:19]/PC[6:3]
ADDR[18:0]
AS/PE5
AVEC/PE2
BERR
CSM/BG
CSE/BGACK
CS0/BR
CLKOUT
CSBOOT
DATA[15:0]
DS/PE4
DSACK0/PE0
DSACK1/PE1
CS5/FC2/PC2
FC1/PC1
CS3/FC0/PC0
HALT
IRQ[7:1]/PF[7:1]
MODCLK/PF0
R/W
RESET
RMC
SIZ[1:0]/PE[7:6]
TSC
1
1
Unknown
Unknown
Unknown
Input
Input
Input
1
Input
Input
Output
0
Input
Input
Input
Input
Unknown
Unknown
Unknown
Input
Input
Input
Output
Input
Input
Input
Input
Unknown
Output
Input
Input
1
1
1
Output
0
Input
Output
Input
Input
1
1
1
Input
Input
Input
Output
Input
Output
Unknown
Input
相關PDF資料 |
PDF描述 |
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| MC68331VPV20 | User’s Manual |
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相關代理商/技術參數 |
參數描述 |
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