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參數資料
| 型號： | MC68331VFV20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | User’s Manual |
| 中文描述： | 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | QFP-144 |
| 文件頁數： | 167/254頁 |
| 文件大?。?/td> | 1354K |
| 代理商： | MC68331VFV20 |
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MC68331
USER’S MANUAL
GENERAL-PURPOSE TIMER
MOTOROLA
7-9
7
Figure 7-2 Prescaler Block Diagram
Multiplexer outputs (including the PCLK signal) can be connected to external pins) can
be connected to external pins. The CPROUT bit in the TMSK2 register configures the
OC1 pin to output the TCNT clock and the PPROUT bit in the PWMC register config-
ures the PWMA pin to output the PWMC clock. CPROUT and PPROUT can be written
at any time. Clock signals on OC1 and PWMA do not have a 50% duty cycle. They
have the period of the selected clock but are high for only one system clock time.
The prescaler also supplies three clock signals to the pulse accumulator clock select
mux. These are the system clock divided by 512, the external clock signal from the
PCLK pin and the capture/compare clock signal.
7.8 Capture/Compare Unit
The capture/compare unit contains the timer counter (TCNT), the input capture (IC)
functions and the output compare (OC) functions.
Figure 7-3
is a block diagram of the
capture/compare unit.
GPT PRESCALER BLOCK
TO PULSE ACCUMULATOR
TO PULSE ACCUMULATOR
CPR2 CPR1 CPR0
PPR2 PPR1 PPR0
TO PULSE ACCUMULATOR
TO
PWM UNIT
TO CAPTURE/
COMPARE
TIMER
SELECT
SELECT
SYNCHRONIZER AND
DIGITAL FILTER
PCLK
PIN
DIVIDER
÷
256
÷
128
÷
64
÷
32
÷
16
÷
8
÷
4
EXT.
÷
128
÷
64
÷
32
÷
16
÷
8
÷
4
÷
2
EXT.
SYSTEM CLOCK
÷
512
EXT.
÷
2
÷
1
÷
6
÷
3
÷
1
÷
8
÷
4
÷
5
÷
2
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