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參數資料
| 型號： | MC68EN360FE25V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數： | 748/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE25V |
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Applications
9-28
MC68360 USER’S MANUAL
MOTOROLA
The TPM bits remain the same and are located in the PSMR.
The HDLC mode register is implemented using the GSMR and the PSMR. One GSMR and
one PSMR exist for each SCC. The definition of the PSMR differs based on the protocol
used.
The ENC bit becomes the TENC and RENC bits in the GSMR. Note that the QUICC con-
tains many more data encoding options.
The FLG bit becomes the RTSM bit in the GSMR.
The RTE bit is located in the PSMR.
The FSE bit is located in the PSMR.
The C32 bit becomes the two CRC bits in the PSMR. If C32 = 0, then initialize CRC to 00.
If C32 = 1, then initialize CRC to 10.
The NOF bits are located in the PSMR.
The BISYNC mode register is implemented using the GSMR and the PSMR. One GSMR
and one PSMR exist for each SCC. The definition of the PSMR differs based on the protocol
used.
The ENC bit becomes the TENC and RENC bits in the GSMR. Note that the QUICC con-
tains many more data encoding options.
The SYNF bit becomes the RTSM bit in the GSMR.
The RBCS bit is located in the PSMR.
The RTR bit is located in the PSMR.
The BCS bit becomes the two CRC bits in the PSMR. If BCS = 0, initialize CRC to 11. If
BCS = 1, initialize CRC to 01.
The REVD bit becomes the RVD bit in the PSMR. Note that the RVD bit in the PSMR is
not the same as the REVD bit in the GSMR.
The NTSYN bit should not have been set in BISYNC mode, and therefore is not ported.
If the EXSYN bit was set, the CDP and CTSP bit in the GSMR should be set for compat-
ibility. The user may also wish to leave the CDS and CTSS bits cleared in the GSMR.
The PM bit becomes the TPM and RPM bits in the PSMR. Note that more parity options
are now available.
NOTE
The SYNL bits in the GSMR were added to offer more synchro-
nization options than are available on the MC68302.
The DDCMP mode register is a microcode RAM product on the QUICC. The port of DDCMP
from the MC68302 is not discussed in this section.
The V.110 mode register is not supported on the QUICC.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68EN360FE33 | QUad Integrated Communications Controller Users Manual |
| MC68EN360RC25 | QUad Integrated Communications Controller Users Manual |
| MC68MH360FE25 | QUad Integrated Communications Controller Users Manual |
| MC68EN360RC33 | AC 4C 4#12 SKT PLUG 025 |
| MC68EN360ZP25 | QUad Integrated Communications Controller Users Manual |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68EN360FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360FS25C | 制造商:Motorola 功能描述:68EN360 S2C4B |
| MC68EN360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360RC25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360RC25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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