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參數(shù)資料
| 型號(hào)： | MC68HC705B16N |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
| 中文描述： | 8位微控制器單元（MCU）。（8位微控制器） |
| 文件頁數(shù)： | 85/298頁 |
| 文件大小： | 3532K |
| 代理商： | MC68HC705B16N |
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MC68HC05B6
Rev. 4
MOTOROLA
6-13
SERIAL COMMUNICATIONS INTERFACE
6
LBCL – Last bit clock
This bit allows the user to select whether the clock associated with the last data bit transmitted
(MSB) has to be output to the SCLK pin. The clock of the last data bit is output to the SCLK pin if
the LBCL bit is a logic one, and is not output if it is a logic zero.
The last bit is the 8th or 9th data bit transmitted depending on the 8 or 9 bit format selected by M-bit
(seeTable 6-2).
This bit should not be manipulated while the transmitter is enabled.
Figure 6-10
SCI data clock timing diagram (M=1)
Table 6-2
SCI clock on SCLK pin
Data format
M-bit
LBCL bit
Number of clocks on
SCLK pin
7
8
8
9
8 bit
8 bit
9 bit
9 bit
0
0
1
1
0
1
0
1
Idle or preceding
transmssion
clock
(CPOL = 0, CPHA = 0)
Stop
Start
LSB
data
M= 1 (9 data bits)
Idle or next
transmssion
LBCL bit controls last data clock
clock
(CPOL = 0, CPHA = 1)
clock
(CPOL = 1, CPHA = 0)
clock
(CPOL = 1, CPHA = 1)
*
*
*
*
Start
Stop
0
1
2
3
4
5
6
MSB
7
*
8
TPG
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PDF描述 |
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