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參數資料
| 型號： | MC68HC705C9ACB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers |
| 中文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | PLASTIC, SHRINK, DIP-42 |
| 文件頁數： | 25/160頁 |
| 文件大小： | 2076K |
| 代理商： | MC68HC705C9ACB |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁當前第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁
General Description
Configuration Options
MC68HC705C9A — Rev. 4.0
Advance Information
MOTOROLA
General Description
25
SPI output signals (MOSI, MISO, and SCK) require the
corresponding bits in the port D data direction register to be set for
output.
The port D wire-OR mode control bit (bit 5 of SPCR $000A) is
enabled, allowing open-drain configuration of port D.
The RESET pin becomes bidirectional; this pin is driven low by a
C9A COP or clock monitor timeout or during power-on reset.
When configured as an MC68HC05C12A:
Memory locations $0100–$0FFF are disabled, creating a memory
map identical to the MC68HC05C12A.
C12A options in the C12MOR ($3FF1) are enabled; these bits
control IRQ sensitivity, STOP instruction disable and C12 COP
enable.
The C9A option register ($3FDF) is disabled, preventing software
control over the IRQ sensitivity and the memory map
configuration.
The C9A COP reset register ($001D) and the C9A COP control
register ($001E) are disabled, preventing software control over the
C9A COP and clock monitor.
The C12 COP clear register ($3FF0) is enabled; this write-only
register is used to clear the C12 COP.
The port D data direction register ($0007) is disabled and the
seven port D pins become input only.
SPI output signals (MOSI, MISO, and SCK) do not require the data
direction register control for output capability.
The port D wire-OR mode control bit (bit 5 of SPCR $000A) is
disabled, preventing open-drain configuration of port D.
The RESET pin becomes input only.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC705C9ACFB | Microcontrollers |
| MC68HC705C9ACFN | Microcontrollers |
| MC68HC705C9ACP | Microcontrollers |
| MC68HC705P6A | HCMOS Microcontroller Unit |
| MC68HC705P6ACDW | HCMOS Microcontroller Unit |
相關代理商/技術參數 |
參數描述 |
|---|---|
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