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參數(shù)資料
| 型號： | MC68HC711E20CFS2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers |
| 中文描述： | 8-BIT, UVPROM, 2 MHz, MICROCONTROLLER, CQCC52 |
| 封裝： | WINDOWED, CERAMIC, LCC-52 |
| 文件頁數(shù)： | 153/268頁 |
| 文件大小： | 3696K |
| 代理商： | MC68HC711E20CFS2 |
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Timing System
Output Compare
M68HC11E Family — Rev. 5
Data Sheet
MOTOROLA
Timing System
153
next CPU cycle so that a double-byte read returns the full 16-bit state of the counter
at the time of the MSB read cycle.
9.4.6 Timer Control Register 1
The bits of this register specify the action taken as a result of a successful OCx
compare.
OM[2:5] — Output Mode Bits
OL[2:5] — Output Level Bits
These control bit pairs are encoded to specify the action taken after a successful
OCx compare. OC5 functions only if the I4/O5 bit in the PACTL register is clear.
Refer to
Table 9-3
for the coding.
Register name: Timer Counter Register (High)
Address: $100E
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Write:
Reset:
0
0
0
0
0
0
0
0
Register name: Timer Counter Register (Low)
Address: $100F
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 9-15. Timer Counter Register (TCNT)
Address:
$1020
Bit 7
6
5
4
3
2
1
Bit 0
Read:
OM2
OL2
OM3
OL3
OM4
OL4
OM5
OL5
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 9-16. Timer Control Register 1 (TCTL1)
Table 9-3. Timer Output Compare Actions
OMx
OLx
Action Taken on Successful Compare
0
0
Timer disconnected from output pin logic
0
1
Toggle OCx output line
1
0
Clear OCx output line to 0
1
1
Set OCx output line to 1
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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