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參數(shù)資料
| 型號： | MC68HRC08JK1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | HCMOS Microcontroller Unit |
| 中文描述： | HCMOS微控制器 |
| 文件頁數(shù)： | 77/198頁 |
| 文件大小： | 2403K |
| 代理商： | MC68HRC08JK1 |
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System Integration Module (SIM)
Exception Control
MC68H(R)C08JL3
—
Rev. 4
Technical Data
MOTOROLA
System Integration Module (SIM)
For More Information On This Product,
Go to: www.freescale.com
77
At the beginning of an interrupt, the CPU saves the CPU register
contents on the stack and sets the interrupt mask (I bit) to prevent
additional interrupts. At the end of an interrupt, the RTI instruction
recovers the CPU register contents from the stack so that normal
processing can resume.
Figure 7-9
shows interrupt entry timing.
Figure
7-10
shows interrupt recovery timing.
Figure 7-9
.
Interrupt Entry
Figure 7-10. Interrupt Recovery
7.6.1.1 Hardware Interrupts
A hardware interrupt does not stop the current instruction. Processing of
a hardware interrupt begins after completion of the current instruction.
When the current instruction is complete, the SIM checks all pending
hardware interrupts. If interrupts are not masked (I bit clear in the
condition code register), and if the corresponding interrupt enable bit is
MODULE
INTERRUPT
IDB
R/W
DUMMY
SP
SP – 1
SP – 2
SP – 3
SP – 4
VECT H
VECT L
START ADDR
IAB
DUMMY
PC – 1[7:0] PC – 1[15:8]
X
A
CCR
V DATA H
V DATA L
OPCODE
I BIT
MODULE
INTERRUPT
IDB
R/W
SP – 4
SP – 3
SP – 2
SP – 1
SP
PC
PC + 1
IAB
CCR
A
X
PC – 1[7:0] PC – 1[15:8] OPCODE
OPERAND
I BIT
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HRC08JK3 | HCMOS Microcontroller Unit |
| MC68HRC08JL3 | HCMOS Microcontroller Unit |
| MC68H(R)C08JK3 | HCMOS Microcontroller Unit |
| MC68H(R)C08JL3 | HCMOS Microcontroller Unit |
| MC68HC001 | 2.048V 100ppm/Degrees C, 50uA in SOT23-3 Series (Bandgap) Voltage Reference 3-SOT-23 -40 to 125 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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