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參數資料
型號: MC74HC137N
廠商: MOTOROLA INC
元件分類: 通用總線功能
英文描述: 1-of-8 Decoder/Demultiplexer with Address Latch
中文描述: HC/UH SERIES, OTHER DECODER/DRIVER, INVERTED OUTPUT, PDIP16
封裝: PLASTIC, DIP-16
文件頁數: 1/6頁
文件大小: 210K
代理商: MC74HC137N
SEMICONDUCTOR TECHNICAL DATA
1
REV 6
Motorola, Inc. 1995
10/95
"
!
High–Performance Silicon–Gate CMOS
The MC74HC137 is identical in pinout to the LS137. The device inputs are
compatible with standard CMOS outputs; with pullup resistors, they are
compatible with LSTTL outputs.
The HC137 decodes a three–bit Address to one–of–eight active–low
outputs. The device has a transparent latch for storage of the Address. Two
Chip Selects, one active–low and one active–high, are provided to facilitate
the demultiplexing, cascading, and chip–selecting functions.
The demultiplexing function is accomplished by using the Address inputs
to select the desired device output, and then by using one of the Chip
Selects as a data input while holding the other one active.
The HC137 is the inverting version of the HC237.
Output Drive Capability: 10 LSTTL Loads
Outputs Directly Interface to CMOS, NMOS, and TTL
Operating Voltage Range: 2 to 6 V
Low Input Current: 1
μ
A
High Noise Immunity Characteristic of CMOS Devices
In Compliance with the Requirements Defined by JEDEC Standard
No. 7A
Chip Complexity: 152 FETs or 38 Equivalent Gates
LOGIC DIAGRAM
5
7
Y6
Y5
Y4
Y3
Y2
Y1
Y0
Y7
9
10
11
12
13
14
15
6
4
2
1
CS1
CS2
A0
A1
A2
LATCH ENABLE
ADDRESS
INPUTS
PIN 16 = VCC
PIN 8 = GND
CHIP–
SELECT
INPUTS
TRANS–
PARENT
LATCH
1–OF–8
DECODER
ACTIVE–
LOW
OUTPUTS
3
PIN ASSIGNMENT
13
14
15
16
9
10
11
12
5
4
3
2
1
8
7
6
A0
LATCH ENABLE
A2
A1
Y7
CS1
CS2
GND
Y3
Y2
Y1
Y0
VCC
Y5
Y4
Y6
D SUFFIX
SOIC PACKAGE
CASE 751B–05
N SUFFIX
PLASTIC PACKAGE
CASE 648–08
1
16
1
16
ORDERING INFORMATION
MC74HCXXXN
MC74HCXXXD
Plastic
SOIC
Inputs
Outputs
LE CS1 CS2 A2 A1 A0 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7
X
X
L
L
L
L
L
L
L
L
H
X
L
H
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X
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X
X
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X
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*
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L
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L
H
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H
H
H
H
H
H
H
H
L
FUNCTION TABLE
* = Depends upon the Address previously applied while LE was
at a low level.
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PDF描述
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