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參數資料
型號: MC74HC138AD
廠商: MOTOROLA INC
元件分類: 通用總線功能
英文描述: CAP .0027UF 200V B SERIES POLY
中文描述: HC/UH SERIES, OTHER DECODER/DRIVER, INVERTED OUTPUT, PDSO16
封裝: 0.150 INCH, PLASTIC, SOIC-16
文件頁數: 4/7頁
文件大小: 234K
代理商: MC74HC138AD
MC54/74HC138A
MOTOROLA
High–Speed CMOS Logic Data
DL129 — Rev 6
4
Figure 1.
50%
tPHL
tPLH
VCC
GND
Figure 2.
VALID
VALID
OUTPUT Y
50%
tf
tr
VCC
GND
tPLH
tTLH
90%
50%
10%
OUTPUT Y
INPUT CS1
tPHL
90%
50%
10%
tTHL
INPUT A
SWITCHING WAVEFORMS
tTHL
tTLH
VCC
GND
tr
tPHL
tPLH
OUTPUT Y
INPUT
CS2, CS3
90%
50%
10%
90%
50%
10%
Figure 3.
tf
* Includes all probe and jig capacitance
Figure 4. Test Circuit
CL*
TEST POINT
DEVICE
UNDER
TEST
OUTPUT
PIN DESCRIPTIONS
ADDRESS INPUTS
A0, A1, A2 (Pins 1, 2, 3)
Address inputs. These inputs, when the chip is selected,
determine which of the eight outputs is active–low.
CONTROL INPUTS
CS1, CS2, CS3 (Pins 6, 4, 5)
Chip select inputs. For CS1 at a high level and CS2, CS3
at a low level, the chip is selected and the outputs follow the
Address inputs. For any other combination of CS1, CS2, and
CS3, the outputs are at a logic high.
OUTPUTS
Y0 – Y7 (Pins 15, 14, 13, 12, 11, 10, 9, 7)
Active–low Decoded outputs. These outputs assume a low
level when addressed and the chip is selected. These out-
puts remain high when not addressed or the chip is not
selected.
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