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參數(shù)資料
型號: MC74VHCT132AM
廠商: ON SEMICONDUCTOR
元件分類: 通用總線功能
英文描述: Quad 2-Input NAND Schmitt Trigger
中文描述: AHCT/VHCT SERIES, QUAD 2-INPUT NAND GATE, PDSO14
封裝: EIAJ, SOIC-14
文件頁數(shù): 1/8頁
文件大小: 155K
代理商: MC74VHCT132AM
SEMICONDUCTOR TECHNICAL DATA
1
REV 0
Motorola, Inc. 1999
4/99
" "! !!
The MC74VHCT132A is an advanced high speed CMOS Schmitt NAND
trigger fabricated with silicon gate CMOS technology. It achieves high speed
operation similar to equivalent Bipolar Schottky TTL while maintaining
CMOS low power dissipation.
Pin configuration and function are the same as the MC74VHC00, but the
inputs have hysteresis and, with its Schmitt trigger function, the VHCT132A
can be used as a line receiver which will receive slow input signals.
The VHCT inputs are compatible with TTL levels. This device can be used
as a level converter for interfacing 3.3V to 5.0V, because it has full 5V CMOS
level output swings.
The VHCT132A input structures provide protection when voltages
between 0V and 5.5V are applied, regardless of the supply voltage. The
output structures also provide protection when VCC = 0V. These input and
output structures help prevent device destruction caused by supply voltage
– input/output voltage mismatch, battery backup, hot insertion, etc.
The internal circuit is composed of three stages, including a buffer output
which provides high noise immunity and stable output. The inputs tolerate
voltages up to 7V, allowing the interface of 5V systems to 3V systems.
High Speed: tPD = 4.9ns (Typ) at VCC = 5V
Low Power Dissipation: ICC = 2
μ
A (Max) at TA = 25
°
C
TTL–Compatible Inputs: VIL = 0.8V; VIH = 2.0V
Power Down Protection Provided on Inputs
Balanced Propagation Delays
Designed for 2V to 5.5V Operating Range
Low Noise: VOLP = 0.8V (Max)
Pin and Function Compatible with Other Standard Logic Families
Latchup Performance Exceeds 300mA
ESD Performance: HBM > 2000V; Machine Model > 200V
Chip Complexity: 72 FETs or 18 Equivalent Gates
Pinout: 14–Lead Packages
(Top View)
13
14
12
11
10
9
8
2
1
3
4
5
6
7
VCC
B4
A4
Y4
B3
A3
Y3
A1
B1
Y1
A2
B2
Y2
GND
LOGIC DIAGRAM
Y1
A1
1
3
B1
2
Y2
A2
4
6
B2
5
Y3
A3
9
8
B3
10
Y4
A4
12
11
B4
13
D SUFFIX
14–LEAD SOIC PACKAGE
CASE 751A–03
DT SUFFIX
14–LEAD TSSOP PACKAGE
CASE 948G–01
ORDERING INFORMATION
MC74VHCTXXAD
MC74VHCTXXADT
MC74VHCTXXAM
SOIC
TSSOP
SOIC EIAJ
M SUFFIX
14–LEAD SOIC EIAJ PACKAGE
CASE 965–01
FUNCTION TABLE
Inputs
Output
Y
A
B
L
L
H
H
L
H
L
H
H
H
H
L
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PDF描述
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參數(shù)描述
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