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參數資料
| 型號： | MC68C912B32FU8 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-Bit Microcontroller |
| 中文描述： | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | QFP-80 |
| 文件頁數： | 111/128頁 |
| 文件大小： | 748K |
| 代理商： | MC68C912B32FU8 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁當前第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁
MC68HC912B32
MC68HC912B32TS/D
MOTOROLA
111
The ATD control register 5 is used to select the conversion modes, the conversion channel(s), and ini-
tiate conversions.
Read or write anytime. Writes to the ATD control registers initiate a new conversion sequence. If a con-
version sequence is in progress when a write occurs, that sequence is aborted and the SCF and CCF
bits are reset.
S8CM — Select 8 Channel Mode
0 = Conversion sequence consists of four conversions
1 = Conversion sequence consists of eight conversions
SCAN — Enable Continuous Channel Scan
0 = Single conversion sequence
1 = Continuous conversion sequences (scan mode)
When a conversion sequence is initiated by a write to the ATDCTL register, the user has a choice of
performing a sequence of four (or eight, depending on the S8CM bit) conversions or continuously per-
forming four (or eight) conversion sequences.
MULT — Enable Multichannel Conversion
0 = ATD sequencer runs all four or eight conversions on a
single
input channel selected via the
CD, CC, CB, and CA bits.
1 = ATD sequencer runs each of the four or eight conversions on
sequential
channels in a specific
group. Refer to
Table 41
.
CD, CC, CB, and CA — Channel Select for Conversion
NOTES:
1. Maximum conversion frequency is 2 MHz. Maximum P clock divisor value will become
maximum conversion rate that can be used on this ATD module.
2. Minimum conversion frequency is 500 kHz. Minimum P clock divisor value will become
minimum conversion rate that this ATD can perform.
Table 40 Clock Prescaler Values
Prescale Value
Total Divisor
÷
2
÷
4
÷
6
÷
8
÷
10
÷
12
÷
14
÷
16
Max P Clock
1
Min P Clock
2
00000
4 MHz
1 MHz
00001
8 MHz
2 MHz
00010
8 MHz
3 MHz
00011
8 MHz
4 MHz
00100
8 MHz
5 MHz
00101
8 MHz
6 MHz
00110
8 MHz
7 MHz
00111
8 MHz
8 MHz
01xxx
1xxxx
Do Not Use
ATDCTL5
— ATD Control Register 5
$0065
Bit 7
6
5
4
3
2
1
Bit 0
0
S8CM
SCAN
MULT
CD
CC
CB
CA
RESET:
0
0
0
0
0
0
0
0
相關PDF資料 |
PDF描述 |
|---|---|
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參數描述 |
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