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參數(shù)資料
| 型號(hào)： | MC68EN360CFE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁數(shù)： | 665/962頁 |
| 文件大?。?/td> | 2817K |
| 代理商： | MC68EN360CFE25 |
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Parallel Interface Port (PIP)
MOTOROLA
MC68360 USER’S MANUAL
7-341
T/R—Transmit/Receive Select
This bit selects transmitter or receiver operation for the PIP when it is using the inter-
locked, pulsed, or transparent handshake modes.
0 = Data is input to the PIP.
1 = Data is output from the PIP.
7.13.7.3 PIP TIMING PARAMETERS REGISTER (PTPR).
The PTPR is a 16-bit read-write
register that is cleared at reset. The PTPR holds two timing parameters, TPAR1 and TPAR2,
which are used in the pulsed handshake modes for both a PIP transmitter and a receiver.
TPAR1—Timing Parameter 1
This 8-bit value defines the number of system clocks for TPAR1 in the transmitter or re-
ceiver pulsed handshake mode. The value $00 corresponds to 1 QUICC general system
clock, and the value $FF corresponds to 256 QUICC general system clocks. A general
system clock defaults to 40 ns, assuming a 25-MHz QUICC system.
TPAR2—Timing Parameter 2
This 8-bit value defines the number of system clocks for TPAR2 in the transmitter or re-
ceiver pulsed handshake mode. The value $00 corresponds to 1 QUICC general system
clock, and the value $FF corresponds to 256 QUICC general system clocks. A general
system clock defaults to 40 ns, assuming a 25-MHz QUICC system.
7.13.7.4 PIP BUFFER DESCRIPTORS.
BDs for the receiver and transmitter that support
PIP operation were still in preparation at the time of writing.
7.13.7.5 PIP EVENT REGISTER (PIPE).
The PIPE is an 8-bit register used to report events
recognized by the PIP and to generate interrupts. It shares the same address as the SMC2
event register; thus, SMC2 cannot be used simultaneously with the PIP. Upon recognition
of an event, the PIP sets its corresponding bit in the PIPE. Interrupts generated by this reg-
ister may be masked in the PIP mask register.
The PIPE is a memory-mapped register that may be read at any time. A bit is cleared by
writing a one (writing a zero does not affect a bit’s value). More than one bit may be cleared
at a time. All unmasked bits must be cleared before the CP will clear the internal interrupt
request. This register is cleared at reset.
Bits 7–4—Reserved
CCR—Control Character Received
A control character was received (with reject (R) = 1) and stored in the receive control
character register.
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
TPAR2
TPAR1
7
6
5
4
3
2
1
0
—
CCR
BSY
CHR
BD
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PDF描述 |
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參數(shù)描述 |
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| MC68EN360CVR33L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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| MC68EN360CZQ25L | 功能描述:微處理器 - MPU QUICC ETHRN RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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