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參數(shù)資料
| 型號(hào)： | MC68HC05B8 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
| 中文描述： | 8位微控制器單元（MCU）。（8位微控制器） |
| 文件頁(yè)數(shù)： | 290/298頁(yè) |
| 文件大小： | 3532K |
| 代理商： | MC68HC05B8 |
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MOTOROLA
viii
MC68HC05B6
INDEX
pulse length modulation registers
PLMA, PLMB
5–11
Q
QFP
12–2
R
R8 – Receive data bit 8
6–11
RAM
3–1
RDI
6–6
RDRF – Receive data register full flag
6–16
RE – receiver enable
6–15
receive data in
6–6
receiver
6–3
register outline
3–8
registers
3–1
RESET
9–3
,
E–5
,
F–5
reset timing diagram
9–1
resets
9–1
RIE – receiver interrupt enable
6–14
ROM
3–1
RTIM – Reset time
C–7
,
E–8
,
F–8
RVU
13–2
RWAT – Watchdog after reset
C–7
,
E–8
,
F–8
RWU – receiver wake-up
6–15
S
SBK – Send break
6–15
SCI
block diagram
6–2
receiver
6–3
sampling technique
6–7
synchronous transmission
6–9
transmitter
6–3
two-wire system
6–1
SCI interrupts
9–10
SCI registers
BAUD
6–18
SCCR1
6–10
SCCR2
6–14
SCDR
6–10
SCSR
6–16
SCP1, SCP0 – Serial prescaler select bits
6–18
SCR2, SCR1, SCR0 – SCI rate select bits
6–19
SCT2, SCT1, SCT0 – SCI rate select bits
6–18
SDIP
12–3
SEC – Secure bit
E–9
,
F–9
,
H–12
self-check mode
A–5
self-check ROM
3–2
serial bootstrap
E–16
Serial communications control register 1
6–10
CPHA
6–12
CPOL
6–12
LBCL
6–13
M
6–11
R8
6–11
T8
6–11
WAKE
6–11
Serial communications control register 2
ILIE
6–14
RE
6–15
RIE
6–14
RWU
6–15
SBK
6–15
TCIE
6–14
TE
6–14
TIE
6–14
Serial communications data register
6–10
Serial communications status register
FE
6–17
IDLE
6–16
NF
6–17
OR
6–17
RDRF
6–16
TC
6–16
TDRE
6–16
serial RAM loader
2–2
,
F–16
,
H–19
SFA – Slow or fast mode selection for PLMA
3–10
,
7–3
SFB – Slow or fast mode selection for PLMB
3–10
,
7–3
single chip mode
2–1
SLOW
2–9
SM – Slow mode
3–10
,
7–3
SM – slow mode selection bit
2–9
start bit detection
6–6
STOP
2–6
3–7
,
5–12
,
6–21
,
7–4
,
8–6
,
9–4
T
T8 – transmit data bit 8
6–11
TC – Transmit complete flag
6–16
TCIE – Transmit complete interrupt enable
6–14
TDO
6–8
TDRE – Transmit data register empty flag
6–16
TE – Transmitter enable
6–14
TIE – Transmit interrupt enable
6–14
Timer control register
IEDG1
5–5
OCIE
5–4
OLV1
5–5
OLV2
5–5
TOIE
5–4
timer interrupts
9–10
timer state diagrams
5–12
Timer status register
ICF1
5–6
ICF2
5–7
OCF1
5–6
OCF2
5–7
TOF
5–6
TOF – Timer overflow status flag
5–6
TOIE – Timer overflow interrupt enable
5–4
transmit data out
6–8
TPG
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PDF描述 |
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