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參數(shù)資料
| 型號(hào)： | MC68HC11E9 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-channel, 8-bit analog-to-digital (A/D) converter |
| 中文描述： | 8通道，8位模擬至數(shù)字（A / D）轉(zhuǎn)換器 |
| 文件頁數(shù)： | 112/268頁 |
| 文件大小： | 2221K |
| 代理商： | MC68HC11E9 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁當(dāng)前第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁
Parallel Input/Output (I/O) Ports
Data Sheet
M68HC11E Family — Rev. 5
112
Parallel Input/Output (I/O) Ports
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
PORTCL is used in the handshake clearing mechanism. When an active edge
occurs on the STRA pin, port C data is latched into the PORTCL register. Reads
of this register return the last value latched into PORTCL and clear STAF flag
(following a read of PIOC with STAF set).
DDRC[7:0] — Port C Data Direction Bits
In handshake output mode, DDRC bits select the 3-stated output option
(DDCx = 1).
0 = Input
1 = Output
6.5 Port D
In all modes, port D bits [5:0] can be used either for general-purpose I/O or with the
serial communications interface (SCI) and serial peripheral interface (SPI)
subsystems. During reset, port D pins PD[5:0] are configured as high-impedance
inputs (DDRD bits cleared).
Address:
$1005
Bit 7
6
5
4
3
2
1
Bit 0
Read:
PCL7
PCL6
PCL5
PCL4
PCL3
PCL2
PCL1
PCL0
Write:
Reset:
Indeterminate after reset
Figure 6-5. Port C Latched Register (PORTCL)
Address:
$1007
Bit 7
6
5
4
3
2
1
Bit 0
Read:
DDRC7
DDRC6
DDRC5
DDRC4
DDRC3
DDRC2
DDRC1
DDRC0
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 6-6. Port C Data Direction Register (DDRC)
Address:
$1008
Bit 7
6
5
4
3
2
1
Bit 0
Read:
0
0
PD5
PD4
PD3
PD2
PD1
PD0
Write:
Reset:
—
—
I
I
I
I
I
I
Alternate Function:
—
—
PD5
SS
PD4
SCK
PD3
MOSI
PD2
MISO
PD1
Tx
PD0
RxD
I = Indeterminate after reset
Figure 6-7. Port D Data Register (PORTD)
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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