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參數資料
| 型號： | MC68HC912D60A |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數： | 374/460頁 |
| 文件大小： | 3130K |
| 代理商： | MC68HC912D60A |
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Analog-to-Digital Converter
Technical Data
MC68HC912D60A — Rev 3.0
374
Analog-to-Digital Converter
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
18.9.6 ATDTEST Module Test Register (ATDTEST)
The test registers implement various special (test) modes used to test
the ATD module. The reset bit in ATDTEST1 is always read/write
. The
SAR (successive approximation register) can always be read but only
written in special (test) mode.
The functions implemented by the test registers are reserved for factory
test.
SAR[9:0] — Successive Approximation Register
This ten bit value represents the contents of the AD machine’s
successive approximation register. This value can always be read. It
can only be written in special (test) mode. Note that ATDTEST0 acts
as a ten bit register since the entire SAR is read/written when
accessing this address.
RST — Test Mode Reset Bit
0 = No reset
1 = Reset the ATD module
When set, this bit causes the ATD module to reset itself. This sets all
registers to their reset state (note the reset state of the reset bit is
zero), the current conversion and conversion sequence are aborted,
pending interrupts are cleared, and the module is placed in an idle
mode.
ATD0TESTH/ATD1TESTH
— ATD Test Register
$0068/$01E8
Bit 7
SAR9
0
6
5
4
3
2
1
Bit 0
SAR2
0
SAR8
0
SAR7
0
SAR6
0
SAR5
0
SAR4
0
SAR3
0
RESET:
ATD0TESTL/ATD1TESTL
— ATD Test Register
$0069/$01E9
Bit 7
SAR1
0
6
5
4
0
0
3
0
0
2
0
0
1
0
0
Bit 0
0
0
SAR0
0
RST
0
RESET:
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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參數描述 |
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