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參數資料
型號: MC908QL4DW
廠商: Motorola, Inc.
英文描述: Microcontrollers
中文描述: 微控制器
文件頁數: 164/222頁
文件大小: 2861K
代理商: MC908QL4DW
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁當前第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁
Slave LIN Interface Controller (SLIC) Module
MC68HC908QL4 MC68HC908QL3 MC68HC908QL2 Data Sheet, Rev. 4
164
Freescale Semiconductor
delay values (cutoff values) are shown in the frequency and time domains. Note that
Table 14-7
shows
the filter performance under ideal conditions.
When switching between a low-speed (< 4800 bps) to a high-speed (> 40000 bps) LIN message, the
master node must allow a minimum idle time of eight bit times (of the slowest bit rate) between the
messages. This prevents a valid message at another frequency from being detected as an invalid
message.
Table 14-6. Maximum LIN Bit Rates for High-Speed Operation Due to Digital Receive Filter
SLIC
Clock
(MHz)
Maximum LIN
Bit Rate for ±1.5%
SLIC Accuracy
(for Master-Slave
Communication
(Bits / Second)
DIGITAL RX FILTER
NOT CONSIDERED
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷
4
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷
3
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷
2
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷
1
(Bits / Second)
THESE PRESCALERS
NOT RECOMMENDED FOR
HIGH-SPEED LIN OPERATION
8
120,000
120,000
(1)
1. Bit rates over 120,000 bits per second are not recommended for LIN communications, as physical layer delay between the
TX and RX pins can cause the stop bit of a byte to be mis-sampled as the last data bit. This could result in a byte framing
error.
120,000
(1)
120,000
(1)
120,000
(1)
6.4
96,000
100,000
120,000
(1)
120,000
(1)
120,000
(1)
4.8
72,000
75,000
100,000
120,000
(1)
120,000
(1)
4
60,000
62,500
83,333
120,000
(1)
120,000
(1)
3.2
48,000
50,000
66,667
100,000
120,000
(1)
2.4
36,000
37,500
50,000
75,000
120,000
(1)
2
30,000
31,250
41,667
62,500
120,000
(1)
Table 14-7. Digital Receive Filter Absolute Cutoff (Ideal Conditions)
SLIC
Clock
(MHz)
Digital RX Filter
Set to
÷
4
Digital RX Filter
Set to
÷
3
Digital RX Filter
Set to
÷
2
Digital RX Filter
Set to
÷
1
Max.
Bit Rate
(Bits /
Sec)
Min Pulse
Width
Allowed
(
μ
s)
Max.
Bit Rate
(Bits /
Sec)
Min Pulse
Width
Allowed
(
μ
s)
Max.
Bit Rate
(Bits /
Sec)
Min Pulse
Width
Allowed
(
μ
s)
Max.
Bit Rate
(Bits /
Sec)
Min Pulse
Width
Allowed
(
μ
s)
8
125,000
8.0
166,667
6.0
250,000
4.0
500,000
2.0
6.4
100,000
10.0
133,333
7.5
200,000
5.0
400,000
2.5
4.8
75,000
13.3
100,000
10.0
150,000
6.7
300,000
3.3
4
62,500
16.0
83,333
12.0
125,000
8.0
250,000
4.0
3.2
50,000
20.0
66,667
15.0
100,000
10.0
200,000
5.0
2.4
37,500
26.7
50,000
20.0
75,000
13.3
150,000
6.7
2
31,250
32.0
41,667
24.0
62,500
16.0
125,000
8.0
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