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參數資料
| 型號： | MC68331CFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | User’s Manual |
| 中文描述： | 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數： | 49/254頁 |
| 文件大小： | 1354K |
| 代理商： | MC68331CFC20 |
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MC68331
USER’S MANUAL
SYSTEM INTEGRATION MODULE
MOTOROLA
4-7
4
Figure 4-3 Periodic Interrupt Timer and Software Watchdog Timer
4.2.11 Periodic Interrupt Timer
The periodic interrupt timer allows the generation of interrupts of specific priority at pre-
determined intervals. This capability is often used to schedule control system tasks
that must be performed within time constraints. The timer consists of a prescaler, a
modulus counter, and registers that determine interrupt timing, priority and vector as-
signment. Refer to
SECTION 5 CENTRAL PROCESSING UNIT
for further information
about interrupt exception processing.
The periodic interrupt modulus counter is clocked by a signal derived from the buffered
crystal oscillator (EXTAL) input pin unless an external frequency source is used. The
value of the periodic timer prescaler (PTP) bit in the periodic interrupt timer register
(PITR) determines system clock prescaling for the watchdog timer. One of two op-
tions, either no prescaling, or prescaling by a factor of 512, can be selected. The value
of PTP is affected by the state of the MODCLK pin during reset, as shown in
Table 4-
5
. System software can change PTP value.
Either clock signal (EXTAL or EXTAL
÷
512) is divided by four before driving the mod-
ulus counter (PITCLK). The modulus counter is initialized by writing a value to the pe-
riodic timer modulus timer modulus (PITM) field in the PITR. A zero value turns off the
periodic timer. When the modulus counter value reaches zero, an interrupt is generat-
ed. The modulus counter is then reloaded with the value in PITM and counting repeats.
If a new value is written to PITR, it is loaded into the modulus counter when the current
count is completed.
Table 4-5 MODCLK Pin and PTP Bit at Reset
MODCLK
0 (External Clock)
1 (Internal Clock)
PTP
1 (
÷
512)
0 (
÷
1)
CLOCK
DISABLE
PRESCALER (2
9
)
CLOCK
MUX
EXTAL
LPSTOP
SWT1
SWT0
SWE
SWP
PTP
FREEZE
SWCLK
PITCLK
PRECLK
2
9
÷
4
RESET
PIT
INTERRUPT
PITR
15 STAGE
DIVIDER CHAIN (2
15
)
2
11
2
13
2
15
8-BIT MODULUS
COUNTER
PIT BLOCK
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