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參數(shù)資料
型號(hào): MC68CK338
廠商: Motorola, Inc.
元件分類: 32位微控制器
英文描述: Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述: 高度集成,低功耗,32位微控制器
文件頁數(shù): 23/133頁
文件大小: 798K
代理商: MC68CK338
MC68CK338
MC68CK338TS/D
MOTOROLA
23
SWP — Software Watchdog Prescaler
This bit controls the value of the software watchdog prescaler.
0 = Software watchdog clock not prescaled
1 = Software watchdog clock prescaled by 512
SWT[1:0] — Software Watchdog Timing
This field selects the divide ratio used to establish software watchdog time-out period.
Table 9
gives the
ratio for each combination of SWP and SWT bits.
HME — Halt Monitor Enable
0 = Disable halt monitor function
1 = Enable halt monitor function
BME — Bus Monitor Enable
0 = Disable bus monitor function for internal to external bus cycles.
1 = Enable bus monitor function for internal to external bus cycles.
BMT[1:0] — Bus Monitor Timing
This bit field selects the time-out period in system clocks for the bus monitor. Refer to
Table 10
.
3.4.2 Bus Monitor
The internal bus monitor checks for excessively long DSACK response times during normal bus cycles
and for excessively long DSACK or AVEC response times during interrupt acknowledge (IACK) cycles.
The monitor asserts BERR if the response time exceeds a user-specified time-out period.
DSACK and AVEC response times are measured in clock cycles. The maximum allowable response
time can be selected by setting the BMT[1:0] field.
Table 9 Software Watchdog Timing Field
SWP
SWT[1:0]
Watchdog Time-Out Period
2
9
÷
f
sys
2
11
÷
f
sys
2
13
÷
f
sys
2
15
÷
f
sys
2
18
÷
f
sys
2
20
÷
f
sys
2
22
÷
f
sys
2
24
÷
f
sys
0
00
0
01
0
10
0
11
1
00
1
01
1
10
1
11
Table 10 Bus Monitor Time-Out Period
BMT[1:0]
00
01
10
11
Bus Monitor Time-Out Period
64 system clocks
32 system clocks
16 system clocks
8 system clocks
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PDF描述
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