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參數(shù)資料
型號(hào)： MC68EN360FE33
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： QUad Integrated Communications Controller Users Manual
中文描述： 32-BIT, 33 MHz, RISC MICROCONTROLLER, CQFP240
封裝： CERAMIC, QFP-240
文件頁(yè)數(shù)： 489/962頁(yè)
文件大小： 2817K
代理商： MC68EN360FE33
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Serial Communication Controllers (SCCs)
MOTOROLA
MC68360 USER’S MANUAL
7-165
Figure 7-49. UART Interrupt Events Example
The UART event register is a memory-mapped register that may be read at any time. A bit
is cleared by writing a one (writing a zero does not affect a bit’s value). More than one bit
may be cleared at a time. All unmasked bits must be cleared before the CP will clear the
internal interrupt request. This register is cleared at reset.
Bits 15–13, 10, 4—Reserved
These bits should be written with zeros.
GLr—Glitch on Rx
A clock glitch was detected by this SCC on the receive clock.
15
14
—
13
12
GLr
11
GLt
10
—
9
8
7
6
5
4
—
3
2
1
TX
0
AB
IDL
GRA
BRKe
BRKs
CCR
BSY
RX
LINE IDLE
10 CHARACTERS
CHARACTERS
RECEIVED BY UART
TIME
RXD
CD
LINE IDLE
LINE IDLE
7 CHARACTERS
CTS
LINE IDLE
TXD
RTS
IDL
RX
CD
CD
RX
CCR
CTS
CTS
TX
BREAK
BRKs
NOTES:
1. The first RX event assumes receive buffers are 6 bytes each.
2. The second IDL event occurs after an all-ones character is received.
3. The second RX event position is programmable based on the MAX_IDL value.
4. The BRKs event occurs after the first break character is received.
5. The CD event must be programmed in the port C parallel I/O, not in the SCC itself.
NOTES:
1. TX event assumes all seven characters were put into a single buffer and CR = 1 in the Tx BD.
2. The CTS event must be programmed in the port C parallel I/O, not in the SCC itself.
UART SCCE
EVENTS
UART SCCE
EVENTS
CHARACTERS
TRANSMITTED BY UART
IDL
A receive control character defined not to be stored in the receive buffer.
LEGEND:
IDL
IDL
BRKe
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PDF描述
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