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參數(shù)資料
| 型號： | MC68HC11E9VFU2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MNX Series Enclosure; NEMA Type:1, 2, 4, 4X, 6, 12, 13; Enclosure Material:Polycarbonate; External Height:5.1"; External Width:3"; External Depth:5.1" |
| 中文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | QFP-64 |
| 文件頁數(shù)： | 24/268頁 |
| 文件大小： | 3696K |
| 代理商： | MC68HC11E9VFU2 |
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General Description
Data Sheet
M68HC11E Family — Rev. 5
24
General Description
MOTOROLA
1.4.2 RESET
A bidirectional control signal, RESET, acts as an input to initialize the MCU to a
known startup state. It also acts as an open-drain output to indicate that an internal
failure has been detected in either the clock monitor or computer operating properly
(COP) watchdog circuit. The CPU distinguishes between internal and external
reset conditions by sensing whether the reset pin rises to a logic 1 in less than two
E-clock cycles after a reset has occurred. See
Figure 1-7
and
Figure 1-8
.
CAUTION:
Do not connect an external resistor capacitor (RC) power-up delay circuit to the
reset pin of M68HC11 devices because the circuit charge time constant can cause
the device to misinterpret the type of reset that occurred.
Because the CPU is not able to fetch and execute instructions properly when V
DD
falls below the minimum operating voltage level, reset must be controlled. A
low-voltage inhibit (LVI) circuit is required primarily for protection of EEPROM
contents. However, since the configuration register (CONFIG) value is read from
the EEPROM, protection is required even if the EEPROM array is not being used.
Presently, there are several economical ways to solve this problem. For example,
two good external components for LVI reset are:
1.
The Seiko S0854HN (or other S805 series devices):
a.
Extremely low power (2
μ
A)
a.
TO-92 package
a.
Limited temperature range, –20
°
C to +70
°
C
a.
Available in various trip-point voltage ranges
2.
The Motorola MC34064:
a.
TO-92 or SO-8 package
a.
Draws about 300
μ
A
a.
Temperature range –40
°
C to 85
°
C
a.
Well controlled trip point
a.
Inexpensive
Refer to
Section 5. Resets and Interrupts
for further information.
1.4.3 Crystal Driver and External Clock Input (XTAL and EXTAL)
These two pins provide the interface for either a crystal or a CMOS- compatible
clock to control the internal clock generator circuitry. The frequency applied to
these pins is four times higher than the desired E-clock rate.
The XTAL pin must be left unterminated when an external CMOS- compatible clock
input is connected to the EXTAL pin. The XTAL output is normally intended to drive
only a crystal. Refer to
Figure 1-9
and
Figure 1-10
.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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