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參數(shù)資料
| 型號： | MC68HC12BE32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-bit Microcontroller Units (MCUs)(16位微控制器) |
| 中文描述： | 16位微控制器單元（MCU）（16位微控制器） |
| 文件頁數(shù)： | 93/422頁 |
| 文件大小： | 3775K |
| 代理商： | MC68HC12BE32 |
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Resets and Interrupts
Interrupt Recognition
MC68HC912B32 MC68HC12BE32 — Rev. 3.0
Advance Information
MOTOROLA
Resets and Interrupts
93
If the MCU comes out of reset in a single-chip mode, all ports are
configured as general-purpose high-impedance inputs.
4.8.5 Central Processing Unit (CPU)
After reset, the CPU fetches a vector from the appropriate address and
beginsexecutinginstructions.ThestackpointerandotherCPUregisters
are indeterminate immediately after reset. The condition code register
(CCR) X and I interrupt mask bits are set to mask any interrupt requests.
The S bit is also set to inhibit the STOP instruction.
4.8.6 Memory
After reset, the internal register block is located at $0000–$01FF, the
register-following space is at $0200–$03FF, and RAM is at
$0800–$0BFF. EEPROM is located at $0D00–$0FFF. FLASH
EEPROM/ROM is located at $8000–$FFFF in single-chip modes and at
$0000–$7FFF (but disabled) in expanded modes.
4.8.7 Other Resources
The timer, serial communications interface (SCI), serial peripheral
interface (SPI), byte data link controller (BDLC), pulse-width modulator
(PWM), and analog-to-digital converter (ATD) are off after reset.
4.9 Interrupt Recognition
Once enabled, an interrupt request can be recognized at any time after
the I bit in the CCR is cleared. When an interrupt request is recognized,
the CPU responds at the completion of the instruction being executed.
Interrupt latency varies according to the number of cycles required to
complete the instruction. Some of the longer instructions can be
interrupted and resume normally after servicing the interrupt.
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PDF描述 |
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參數(shù)描述 |
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| MC68HC16Z1CAG16 | 制造商:Freescale Semiconductor 功能描述:IC16-BIT MICROCONTROLLER |
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| MC68HC16Z1CAG20 | 制造商:Freescale Semiconductor 功能描述:Microcontroller |
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