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參數資料
| 型號： | MC68HC912DT128A |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁數： | 182/404頁 |
| 文件大小： | 2141K |
| 代理商： | MC68HC912DT128A |
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Pulse-Width Modulator
MC68HC912DT128A Rev 2.0
182
Pulse-Width Modulator
MOTOROLA
and then write the counter forcing a new period to start with the new
period value.
Period = Channel-Clock-Period
×
(PWPER
+
1)
Period = Channel-Clock-Period
×
(2
×
PWPER)
(CENTR = 0)
(CENTR = 1)
Read and write anytime.
The value in each duty register determines the duty of the associated
PWM channel. When the duty value is equal to the counter value, the
output changes state. If the register is written while the channel is
enabled, the new value is held in a buffer until the counter rolls over
or the channel is disabled. Reading this register returns the most
recent value written.
If the duty register is greater than or equal to the value in the period
register, there will be no duty change in state. If the duty register is set
to $FF the output will always be in the state which would normally be
the state opposite the PPOLx value.
Left-Aligned-Output Mode (CENTR = 0):
Duty cycle = [(PWDTYx+1)
/
(PWPERx+1)]
×
100%
Duty cycle = [(PWPERx
PWDTYx)
/
(PWPERx+1)]
×
100%
(PPOLx = 1)
(PPOLx = 0)
Center-Aligned-Output Mode (CENTR = 1):
Duty cycle = [(PWPERx
PWDTYx)
/
PWPERx]
×
100%
Duty cycle = [PWDTYx
/
PWPERx]
×
100%
(PPOLx = 0)
(PPOLx = 1)
PWDTYx
—
PWM Channel Duty Registers
Bit 7
6
5
4
3
2
1
Bit 0
PWDTY0
Bit 7
6
5
4
3
2
1
Bit 0
$0050
PWDTY1
Bit 7
6
5
4
3
2
1
Bit 0
$0051
PWDTY2
Bit 7
6
5
4
3
2
1
Bit 0
$0052
PWDTY3
Bit 7
6
5
4
3
2
1
Bit 0
$0053
RESET:
1
1
1
1
1
1
1
1
12-pwm
相關PDF資料 |
PDF描述 |
|---|---|
| MC92052 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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