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參數資料
| 型號： | MC68MH360RC25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | QUad Integrated Communications Controller Users Manual |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
| 封裝： | PGA-241 |
| 文件頁數： | 237/962頁 |
| 文件大小： | 2817K |
| 代理商： | MC68MH360RC25 |
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CPU32+
MOTOROLA
MC68360 USER’S MANUAL
5-95
5.7.2.6 IMMEDIATE ARITHMETIC/LOGIC INSTRUCTIONS.
The immediate arithmetic/
logic instruction table indicates the number of clock periods needed for the processor to
fetch the source immediate data value and to perform the specified arithmetic/logic instruc-
tion using the specified addressing mode. Footnotes indicate when to account for the appro-
priate fetch effective or fetch immediate EA times. The total number of clock cycles is
outside the parentheses. The numbers inside parentheses (r/p/w) are included in the total
clock cycle number. All timing data assumes two-clock reads and writes.
5.7.2.7 BINARY-CODED DECIMAL AND EXTENDED INSTRUCTIONS.
The BCD and
extended instruction table indicates the number of clock periods needed for the processor
to perform the specified operation using the specified addressing mode. No additional tables
are needed to calculate total effective execution time for these instructions. The total number
of clock cycles is outside the parentheses. The numbers inside parentheses (r/p/w) are
included in the total clock cycle number. All timing data assumes two-clock reads and writes.
X = There is one bus cycle for byte and word operands and two bus cycles for long operands.
For long bus cycles, add two clocks to the tail and to the number of cycles.
Timing is calculated with the CPU32+ in 16-bit mode.
<
= Maximum time (certain data or mode combinations may execute faster).
su = The execution time is identical for signed or unsigned operands.
*
= These instructions have an additional save operation that other instructions do not have.
To calculate total instruction time, calculate save,
ea
, and operation execution times,
then combine in the order listed, using equations in 5.7.1.6 Instruction Execution Time
Calculation. A save operation is not run for long-word divide and multiply instructions
when
FEA
=
Dn.
Instruction
Head
Tail
Cycles
MOVEQ#, Dn
0
0
2(0/1/0)
ADDQ
#, Rn
0
0
2(0/1/0)
ADDQ
#,
FEA
0
3
5(0/1/x)
SUBQ
#, Rn
0
0
2(0/1/0)
SUBQ
#,
FEA
0
3
5(0/1/x)
ADDI
#, Rn
0
0
2(0/1/0)
5(0/1/x)
2(0/1/0)
5(0/1/x)
2(0/1/0)
5(0/1/x)
2(0/1/0)
5(0/1/x)
2(0/1/0)
5(0/1/x)
2(0/1/0)
5(0/1/x)
ADDI
#,
FEA
0
3
ANDI
#, Rn
0
0
ANDI
#,
FEA
0
3
EORI
#, Rn
0
0
EORI
#,
FEA
0
3
ORI
#, Rn
0
0
ORI
#,
FEA
0
3
SUBI
#, Rn
0
0
SUBI
#,
FEA
0
3
CMPI
#, Rn
0
0
CMPI
#,
FEA
0
3
X =
There is one bus cycle for byte and word operands and two bus cycles for long-word op-
erands. For long-word bus cycles, add two clocks to the tail and to the number of cycles.
Timing is calculated with the CPU32+ in 16-bit mode.
An # fetch EA time must be added for this instruction:
FEA
+
FEA
+
OPER
=
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