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參數資料
型號： MC68MH360RC25
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： QUad Integrated Communications Controller Users Manual
中文描述： 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241
封裝： PGA-241
文件頁數： 948/962頁
文件大小： 2817K
代理商： MC68MH360RC25
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Index
INDEX-8
MC68356 USER’S MANUAL
MOTOROLA
58
Halt Termination 4-41
Hardware Breakpoint 5-37, 5-39, 5-43, 5-56
Hash Table Algorithm 7-253
HDLC 7-114, 7-116, 7-169, 7-178, A-1
DPLL Error 7-182
FIFO 7-177, 7-179
Flag Status 7-186
Frames Threshold 7-174
Glitch 7-185
HDLC Address Recognition Example 7-
174
HDLC Channel Frame Reception
Processing 7-172
HDLC Channel Frame Transmission
Processing 7-171
HDLC Command Set 7-175
HDLC Controller 7-169
HDLC Error-Handling 7-176
HDLC Example 7-187
HDLC Framing Structure 7-171
HDLC Memory map 7-172
HDLC Programming Model 7-174
HDLC Rx BD 7-180
Idle Sequence Status 7-186
Nonoctet Aligned 7-177
HDLC Address Recognition Example 7-174
HDLC Bus 7-178
Accessing the HDLC Bus 7-192
Delayed RTS Mode 7-194
GSMR Programming 7-196
HDLC Bus Controller 7-189
HDLC Bus Controller Example 7-196
HDLC Bus Key Features 7-192
HDLC Bus Memory Map and
Programming 7-196
HDLC Bus Multi-Master Configuration 7-
191
HDLC Bus Single-Master Configuration
7-191
Non-Symmetrical Duty Cycle 7-193
PSMR Programming 7-196
T1.605 7-190
Transmission Line Configuration 7-194
TSA Transmission line Configuration 7-
195
HDLC Bus 1-10, 7-189, A-2
HDLC Bus Collision Detection 7-193
HDLC Bus Controller 7-189
HDLC Bus Controller Example 7-196
HDLC Bus Key Features 7-192
HDLC Bus Memory Map and Programming
7-196
HDLC Bus Multi-Master Configuration 7-
191
HDLC Bus Single-Master Configuration 7-
191
HDLC Channel Frame Reception
Processing 7-172
HDLC Channel Frame Transmission
Processing 7-171
HDLC Command Set 7-175
HDLC Controller 7-169
HDLC Error-Handling 7-176
HDLC Example 7-187
HDLC Frames 7-196
HDLC Interrupt 7-185
HDLC Memory Map 7-172
HDLC Programming Model 7-174
HDLC Receive Buffer Descriptor 7-179
HDLC Rx BD 7-180
HDLC Transmit Buffer Descriptor 7-183
Heartbeat 7-257, 7-263
Highest Priority 7-380
HMASK 7-173
I
I/O Pins 7-333
IACK 2-7, 2-8, 6-48
IACK5 4-39
IADDR 7-250
ICCR 7-26
IDL 7-80, 7-90, 7-268
IDL Interface Example 7-91
IDL Interface Programming 7-95
Idle Sequence Status 7-186
Idle Status 7-167
IDMA 6-31, 7-59
IDMA (Independent DMA Controller
External Cycle Steal 7-42
IDMA Controllers 7-24
IDMA (Independent DMA Controller) 7-35,
7-36
Auto Buffer Example 7-56
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