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參數(shù)資料
| 型號(hào)： | MC68HC16R1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁(yè)數(shù)： | 145/357頁(yè) |
| 文件大小： | 1822K |
| 代理商： | MC68HC16R1 |
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MC68HC16R1/916R1
USER’S MANUAL
SINGLE-CHIP INTEGRATION MODULE 2
MOTOROLA
5-49
5.7.3.5 Single-Chip Mode
Single-chip operation is selected when BERR = 0 during reset. BERR can be tied low
permanently to select this configuration. In single-chip configuration, pins DATA[15:0]
are configured as two 8-bit I/O ports, ports G and H. ADDR[18:3] are configured as two
8-bit I/O ports, ports A and B. There is no external data bus path. Expanded mode con-
figuration options are not available: I/O ports A, B, C, E, F, G, and H are always se-
lected. ADDR[2:0] come out of reset in a high-impedance state. After reset, clearing
the ABD bit in SCIMCR enables these pins, and leaving the bit set (its single-chip reset
state) leaves the pins in a disabled (high-impedance) state.
Table 5-19
summarizes SCIM2 pin functions during single-chip operation.
Table 5-19 Single-Chip Mode Reset Configuration
Pin(s) Affected
CSBOOT
ADDR[18:11]
ADDR[10:3]
BR/CS0
FC0/CS3/PC0
FC1/PC1
FC2/CS5/PC2
ADDR19/CS6/PC3
ADDR20/CS7/PC4
ADDR21/CS8/PC5
ADDR22/CS9/PC6
ADDR23/CS10/ECLK
DSACK0/PE0
DSACK1/PE1
AVEC/PE2
PE3
DS/PE4
AS/PE5
SIZ0/PE6
SIZ1/PE7
FASTREF/PF0
IRQ[7:6]/PF[7:6]
DATA[15:8]
DATA[7:0]
BGACK, CSE
BG/CSM
Function
CSBOOT 16-Bit
PA[7:0]
PB[7:0]
CS0
PC[6:0]
—
PE[7:0]
PF0
PF[7:6]
PG[7:0]
PH[7:0]
BGACK
BG
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