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參數資料
型號: MC68HC16R1
廠商: Motorola, Inc.
英文描述: 16-Bit Modular Microcontroller(16位模塊化微控制器)
中文描述: 16位微控制器模塊(16位模塊化微控制器)
文件頁數: 248/357頁
文件大小: 1822K
代理商: MC68HC16R1
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MOTOROLA
12-6
CONFIGURABLE TIMER MODULE 7
MC68HC16R1/916R1
USER’S MANUAL
Figure 12-3 FCSM Block Diagram
12.6.1 FCSM Counter
The FCSM counter consists of a 16-bit register and a 16-bit up-counter. Reading the
register transfers the contents of the counter to the data bus, while a write to the
register loads the counter with a new value. Overflow of the counter is defined to be
the transition from $FFFF to $0000. An overflow condition sets the counter overflow
flag (COF) in the FCSM status/interrupt/control register (FCSMSIC).
NOTE
Reset presets the counter register to $0000. Writing $0000 to the
counter register while the counter’s value is $FFFF does not set the
COF flag and does not generate an interrupt request.
12.6.2 FCSM Clock Sources
The FCSM has eight software selectable counter clock sources, including:
Six CPSM prescaler outputs (PCLK[1:6])
Rising edge on CTM2C input
Falling edge on the CTM2C input
The clock source is selected by the CLK[2:0] bits in FCSMSIC. When the CLK[2:0] bits
are being changed, internal circuitry guarantees that spurious edges occurring on the
CTM2C pin do not affect the FCSM. The read-only IN bit in FCSMSIC reflects the state
of CTM2C. This pin is Schmitt-triggered and is synchronized with the system clock.
The maximum allowable frequency for a clock input on CTM2C is f
sys
/4.
CTMFCSMBLOCK
16-BIT UP COUNTER
IL2
IL1
IL0
IARB3
COF
EDGE
DETECT
TIME BASE BUSES
INTERRUPT
CONTROL
CLOCK
SELECT
IN
CLK1 CLK0
CLK2
OVERFLOW
BUS
SELECT
CONTROL REGISTER BITS
CONTROL REGISTER BITS
DRVA DRVB
CONTROL REGISTER BITS
6 CLOCKS (PCLK[1:6]) FROMPRESCALER
SUBMODULE BUS
TBBA
TBBB
INPUT PIN
CTM2C
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PDF描述
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