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參數(shù)資料
| 型號： | MC68HC16R1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁數(shù)： | 318/357頁 |
| 文件大小： | 1822K |
| 代理商： | MC68HC16R1 |
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MOTOROLA
D-14
REGISTER SUMMARY
MC68HC16R1/916R1
USER’S MANUAL
The reset value of SWP is the complement of the state of the MODCLK pin during
reset.
SWT[1:0] — Software Watchdog Timing
This field selects the divide ratio used to establish the software watchdog timeout
period. Refer to
Table D-6
.
Table D-6 Software Watchdog Divide Ratio
The following equation calculates the timeout period for a slow reference frequency,
where f
ref
is equal to the EXTAL crystal frequency.
The following equation calculates the timeout period for a fast reference frequency.
The following equation calculates the timeout period for an externally input clock
frequency on both slow and fast reference frequency devices, when f
sys
is equal to the
system clock frequency.
HME — Halt Monitor Enable
0 = Halt monitor is disabled.
1 = Halt monitor is enabled.
BME — Bus Monitor External Enable
0 = Disable bus monitor for external bus cycles.
1 = Enable bus monitor for external bus cycles.
SWP
0
SWT[1:0]
00
Divide Ratio
2
9
2
11
0
01
0
10
2
13
2
15
2
18
2
20
2
22
2
24
0
11
1
00
1
01
1
10
1
11
Timeout Period
Divide Ratio Specified by SWP and SWT[1:0]
f
ref
-----------------------------------------------------------------------------------------------------------------------
=
Timeout Period
128
--------------------------------------------------------------------------------------------------------------------------------------------
(
)
Divide Ratio Specified by SWP and SWT[1:0]
(
f
ref
)
=
Timeout Period
Divide Ratio Specified by SWP and SWT[1:0]
f
sys
-----------------------------------------------------------------------------------------------------------------------
=
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PDF描述 |
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| MC68HC16Z1CAG20 | 制造商:Freescale Semiconductor 功能描述:Microcontroller |
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