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參數(shù)資料
| 型號(hào)： | MC68HC916X1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁(yè)數(shù)： | 101/172頁(yè) |
| 文件大小： | 1035K |
| 代理商： | MC68HC916X1 |
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MC68HC916X1
MC68HC916X1TS/D
MOTOROLA
101
7.2 Pin Function
Table 54
is a summary of the functions of the QSM pins when they are not configured for general-
purpose I/O. The QSM data direction register (DDRQS) designates each pin except RXD as an in-
put or output.
1. Y = M111, where M is the logic state of the MM bit in the SCIMCR.
Table 53 QSM Address Map
Address
$YFFC00
1
$YFFC02
$YFFC04
$YFFC06
$YFFC08
$YFFC0A
$YFFC0C
$YFFC0E
$YFFC10
$YFFC12
$YFFC14
$YFFC16
$YFFC18
$YFFC1A
$YFFC1C
$YFFC1E
15
8
7
0
QSM MODULE CONFIGURATION (QSMCR)
QSM TEST (QTEST)
QSM INTERRUPT LEVEL (QILR)
QSM INTERRUPT VECTOR (QIVR)
RESERVED
SCI CONTROL 0 REGISTER (SCCR0)
SCI CONTROL 1 REGISTER (SCCR1)
SCI STATUS REGISTER (SCSR)
SCI DATA REGISTER (SCDR)
RESERVED
RESERVED
NOT USED
PQS PIN ASSIGNMENT (PQSPAR)
SPI CONTROL 0 REGISTER (SPCR0)
SPI CONTROL 1 REGISTER (SPCR1)
SPI CONTROL 2 REGISTER (SPCR2)
SPI CONTROL 3 REGISTER
(SPCR3)
RESERVED
PQS DATA (PORTQS)
PQS DATA DIRECTION (DDRQS)
SPI STATUS REGISTER (SPSR)
$YFFC20–
$YFFCFF
$YFFD00–
$YFFD1F
$YFFD20–
$YFFD3F
$YFFD40–
$YFFD4F
RECEIVE RAM (RR[0:F])
TRANSMIT RAM (TR[0:F])
COMMAND RAM (CR[0:F])
Table 54 QSM Pin Functions
Pin
MISO
Mode
Master
Slave
Master
Slave
Master
Slave
Master
Pin Function
Serial Data Input to QSPI
Serial Data Output from QSPI
Serial Data Output from QSPI
Serial Data Input to QSPI
Clock Output from QSPI
Clock Input to QSPI
Input: Assertion Causes Mode Fault
Output: Selects Peripherals
Input: Selects the QSPI
Output: Selects Peripherals
None
Serial Data Output from SCI
Serial Data Input to SCI
MOSI
SCK
PCS0/SS
Slave
Master
Slave
Transmit
Receive
PCS[3:1]
TXD
RXD
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