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參數(shù)資料
| 型號(hào)： | MC912DG128x |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁(yè)數(shù)： | 286/404頁(yè) |
| 文件大?。?/td> | 2141K |
| 代理商： | MC912DG128X |
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MSCAN Controller
MC68HC912DT128A Rev 2.0
286
MSCAN Controller
MOTOROLA
The previously described timer signal can be routed into the on-chip
timer module (ECT). Under the control of the timer link enable (TLNKEN)
bit in the CMCR0, this signal will be connected to the ECT timer channel
m input
1
.
After ECT timer has been programmed to capture rising edge events, it
can be used under software control to generate 16-bit time stamps which
can be stored with the received message.
Clock System
Figure 47
shows the structure of the msCAN12 clock generation
circuitry. With this flexible clocking scheme the msCAN12 is able to
handle CAN bus rates ranging from 10 kbps up to 1 Mbps.
Figure 47 Clocking Scheme
The clock source bit (CLKSRC) in the msCAN12 module control register
(CMCR1) (see
msCAN12 Bus Timing Register 0 (CBTR0)
) defines
whether the msCAN12 is connected to the output of the crystal oscillator
(EXTALi) or to the system clock (SYSCLK).
The clock source has to be chosen such that the tight oscillator tolerance
requirements (up to 0.4%) of the CAN protocol are met. Additionally, for
high CAN bus rates (1 Mbps), a 50% duty cycle of the clock is required.
1. The timer channel being used for the timer link for CAN0 is channel 4 and for CAN1 is channel
5.
msCAN12
CGM
SYSCLK
EXTALi
CGMCANCLK
Prescaler
(1...64)
Time quanta
clock
CLKSRC
CLKSRC
18-mscan12
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