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參數資料
| 型號： | MC68HC916R1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁數： | 121/357頁 |
| 文件大小： | 1822K |
| 代理商： | MC68HC916R1 |
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MC68HC16R1/916R1
USER’S MANUAL
SINGLE-CHIP INTEGRATION MODULE 2
MOTOROLA
5-25
5.5.1.5 Read/Write Signal
The read/write signal (R/W) determines the direction of the transfer during a bus cycle.
This signal changes state, when required, at the beginning of a bus cycle, and is valid
while AS is asserted. R/W only transitions when a write cycle is preceded by a read
cycle or vice versa. The signal may remain low for two consecutive write cycles.
5.5.1.6 Size Signals
Size signals (SIZ[1:0]) indicate the number of bytes remaining to be transferred during
an operand cycle. They are valid while AS is asserted.
Table 5-9
shows SIZ0 and SIZ1
encoding.
5.5.1.7 Function Codes
The CPU generates function code signals (FC[2:0]) to indicate the type of activity oc-
curring on the data or address bus. These signals can be considered address exten-
sions that can be externally decoded to determine which of eight external address
spaces is accessed during a bus cycle.
Because the CPU16 always operates in supervisor mode (FC2 = 1), address spaces
0 to 3 are not used. Address space 7 is designated CPU space. CPU space is used
for control information not normally associated with read or write bus cycles. Function
codes are valid while AS is asserted.
Table 5-10
shows address space encoding.
5.5.1.8 Data Size Acknowledge Signals
During normal bus transfers, external devices assert the data size acknowledge
signals (DSACK[1:0]) to indicate port width to the MCU. During a read cycle, these
signals tell the MCU to terminate the bus cycle and to latch data. During a write cycle,
the signals indicate that an external device has successfully stored data and that the
cycle can terminate. DSACK[1:0] can also be supplied internally by chip-select logic.
Refer to
5.9 Chip-Selects
for more information.
Table 5-9 Size Signal Encoding
SIZ1
0
1
1
0
SIZ0
1
0
1
0
Transfer Size
Byte
Word
3 Byte
Long word
Table 5-10 Address Space Encoding
FC2
1
1
1
1
FC1
0
0
1
1
FC0
0
1
0
1
Address Space
Reserved
Data space
Program space
CPU space
相關PDF資料 |
PDF描述 |
|---|---|
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