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參數資料
| 型號： | MC68HC916R1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁數： | 257/357頁 |
| 文件大小： | 1822K |
| 代理商： | MC68HC916R1 |
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MC68HC16R1/916R1
USER’S MANUAL
CONFIGURABLE TIMER MODULE 7
MOTOROLA
12-15
Figure 12-7 Pulse-Width Modulation Submodule Block Diagram
12.10.1 Output Flip-Flop and Pin
The output flip-flop is the basic output mechanism of the PWMSM. Except when the
required duty cycle is 0% or 100%, the output flip-flop is set at the beginning of each
period and is cleared at the end of the designated pulse width. The polarity of the out-
put pulse is user programmable. The output flip-flop is connected to a buffer that drives
the PWMSM’s associated output pin. The PWMSM is disabled by clearing the EN bit
in the PWMSM status/interrupt/control register (PWMSIC). When the PWMSM is not
in use, the output pin can be used as a digital output controlled by the POL bit in
PWMSIC.
12.10.2 Clock Selection
The PWMSM contains an 8-bit prescaler that is clocked by the PCLK1 signal (f
sys
÷
2
or f
sys
÷
3) from the CPSM. The CLK[2:0] field in PWMSIC selects which of the eight
prescaler outputs drives the PWMSM counter. Refer to
Table 12-5
for the prescaler
output.
16-BIT UP COUNTER
PWMC
IL2
IL1
IL0
IARB3
STATE
SEQUENCER
÷
256 PRESCALER
(N
COUNT
)
CLK1 CLK0
CLK2
OUTPUT
BUFFER
SET
SUBMODULE BUS
ZERO
DETECT
CONTROL REGISTER BITS
PIN
16-BIT COMPARATOR
PERIOD REGISTER
PWMA2
NEXT PERIOD REGISTER
PWMA1
CLOCK
SELECT
16-BIT COMPARATOR
PULSE WIDTH REGISTER
PWMB2
NEXT PULSE WIDTH
REGISTER PWMB1
OUTPUT
FLIP-FLOP
INTERRUPT
CONTROL
FLAG
POL
LOAD
EN
CLEAR
CLEAR
ALL ZEROS
MATCH
MATCH
LOAD
ENABLE
PCLK1
OUTPUT
PIN
PWMA
PWMB
CTMPWMBLOCK
相關PDF資料 |
PDF描述 |
|---|---|
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參數描述 |
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| MC68HCP11A1FN | 制造商:MOTORALA 功能描述: |
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