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參數資料
| 型號： | MC68HC916R1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁數： | 247/357頁 |
| 文件大小： | 1822K |
| 代理商： | MC68HC916R1 |
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MC68HC16R1/916R1
USER’S MANUAL
CONFIGURABLE TIMER MODULE 7
MOTOROLA
12-5
Figure 12-2 CPSM Block Diagram
12.5.1 CPSM Registers
The CPSM contains a control register (CPCR) and a test register (CPTR). All unused
bits and reserved address locations return zero when read. Writes to unused bits and
reserved address locations have no effect. Refer to
D.7.4 CPSM Control Register
and
D.7.5 CPSM Test Register
for information concerning CPSM register and bit
descriptions.
12.6 Free-Running Counter Submodule (FCSM)
The free-running counter submodule (FCSM) has a 16-bit up counter with an associ-
ated clock source selector, selectable time-base bus drivers, control registers, status
bits, and interrupt logic. When the 16-bit up counter overflows from $FFFF to $0000,
an optional overflow interrupt request can be generated. The current state of the 16-
bit counter is the primary output of the counter submodules. The user can select which,
if any, time base bus is to be driven by the 16-bit counter. A software control register
selects whether the clock input to the counter is one of the taps from the prescaler or
an input pin. The polarity of the external input pin is also programmable.
In order to count, the FCSM requires the CPSM clock signals to be present. After re-
set, the FCSM does not count until the prescaler in the CPSM starts running (when the
software sets the PRUN bit). This allows all counters in the CTM7 submodules to be
synchronized.
The CTM7 has one FCSM.
Figure 12-3
shows a block diagram of the FCSM.
CTMCPSMBLOCK
f
sys
8-BIT
PCLK2 =
PCLK3 =
PCLK4 =
PCLK5 =
PCLK6 =
FIRST CPSM
PRESCALER
SELECT
PCLK1 =
÷
2
÷
4
÷
8
÷
16
÷
32
÷
64
÷
128
PRESCALER
÷
256
PRUN DIV23 PSEL1 PSEL0
CPCR
÷
2 OR
÷
3
f
sys
÷
2
f
sys
÷
4
f
sys
÷
8
f
sys
÷
16
f
sys
÷
32
f
sys
÷
64
f
sys
÷
128
f
sys
÷
256
f
sys
÷
512
f
sys
÷
3
f
sys
÷
6
f
sys
÷
12
f
sys
÷
24
f
sys
÷
48
f
sys
÷
96
f
sys
÷
192
f
sys
÷
384
f
sys
÷
768
DIV23 =
÷
3
DIV23 =
÷
2
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