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參數(shù)資料
| 型號： | MCF5272 |
| 廠商： | Motorola, Inc. |
| 英文描述： | MCF5272 ColdFire Integrated Microprocessor Users Manual |
| 中文描述： | MCF5272的ColdFire集成式微處理器用戶手冊 |
| 文件頁數(shù)： | 136/550頁 |
| 文件大小： | 6709K |
| 代理商： | MCF5272 |
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5-14
MCF5272 User’s Manual
MOTOROLA
Programming Model
NOTE:
The debug module has no hardware interlocks, so to prevent
spurious breakpoint triggers while the breakpoint registers are
being loaded, disable TDR (by clearing TDR[29,13])before
de
fi
ning triggers.
A write to TDR clears the CSR trigger status bits, CSR[BSTAT].
Table 5-14 describes TDR
fi
elds.
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
Field
TRC
EBL
EDLW EDWL EDWU EDLL EDLM EDUM EDUU
DI
EAI
EAR
EAL
EPC
PCI
Reset
0000_0000_0000_0000
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Field
—
EBL
EDLW EDWL EDWU EDLL EDLM EDUM EDUU
DI
EAI
EAR
EAL
EPC
PCI
Reset
0000_0000_0000_0000
R/W Write only. Accessible in supervisor mode as debug control register 0x07 using the WDEBUG instruction and
through the BDM port using the
WDMREG
command.
DRc[4–0]
0x07
Figure 5-11. Trigger Definition Register (TDR)
Table 5-14. TDR Field Descriptions
Bits
Name
Description
31–30
TRC
Trigger response control. Determines how the processor responds to a completed trigger condition.
The trigger response is always displayed on DDATA.
00 Display on DDATA only
01 Processor halt
10 Debug interrupt
11 Reserved
15–14
—
Reserved, should be cleared.
29/13
EBL
Enable breakpoint. Global enable for the breakpoint trigger. Setting TDR[EBL] enables a breakpoint
trigger. Clearing it disables all breakpoints at that level.
28–22
12–6
EDx
Setting an EDx bit enables the corresponding data breakpoint condition based on the size and
placement on the processor’s local data bus. Clearing all EDx bits disables data breakpoints.
28/12
EDLW
Data longword. Entire processor’s local data bus.
27/11
EDWL
Lower data word.
26/10
EDWU
Upper data word.
25/9
EDLL
Lower lower data byte. Low-order byte of the low-order word.
24/8
EDLM
Lower middle data byte. High-order byte of the low-order word.
23/7
EDUM
Upper middle data byte. Low-order byte of the high-order word.
22/6
EDUU
Upper upper data byte. High-order byte of the high-order word.
Second-Level Trigger
First-Level Trigger
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PDF描述 |
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