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參數資料
| 型號： | MCF5272 |
| 廠商： | Motorola, Inc. |
| 英文描述： | MCF5272 ColdFire Integrated Microprocessor Users Manual |
| 中文描述： | MCF5272的ColdFire集成式微處理器用戶手冊 |
| 文件頁數： | 308/550頁 |
| 文件大小： | 6709K |
| 代理商： | MCF5272 |
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13-12
MCF5272 User’s Manual
MOTOROLA
PLIC Timing Generator
The clock generator uses a 14-bit counter to divide CLKIN. This limits the reference
clock’s minimum frequency to CLKIN divided by 16,384.
To summarize these two points:
Synthesized clock x 20 < CLKIN
Reference clock > CLKIN / 16,384
(Recommended)
(Required)
The control of the clock generator block is provided through the PCSR register detailed in
Section 13.5.22, “Clock Select Register (PCSR).”
The process is illustrated by this example. Suppose the following:
CPU clock = 66 MHz
Reference clock = 64 KHz
Synthesized clock = 1.024 MHz
The appropriate reference clock is selected by programming PLCLKSEL[CKI1, CKI0],
Section 13.5.22, “Clock Select Register (PCSR).” The multiplication factor is 16
(1.024 MHz / 64 KHz) and is speci
fi
ed by PLCLKSEL[CMULT0-2]. The division ratio
between the synthesized clock (GDCL), 1.024 MHz, and the synthesized frame sync
(Gen_FSC) must be set. (A Gen_FSC of 8 KHz is assumed). This division ratio is selected
by means of FDIV[2-0]. Finally, the clock generation block should be taken out of bypass
by setting PCSR[NBP].
The above settings can be made by a single write of the 16-bit value 0x802B to PCSR.
The following restrictions should be observed when using the clock generator module:
The smallest multiplication factor is 2.
CLKIN should be signi
fi
cantly greater than (> 20 times) the synthesized clock.
Figure 13-11 and Figure 13-12 show the connectivity and relationship of the timing signals
within the PLIC block.
13.3.2 Super Frame Sync Generation
Figure 13-11 shows the generation of the 2-KHz super frame sync. The choice of either
FSC0 or FSC1 is possible using P1CR[FSM]. This allows either the port 0 or port 1 timing
to be used to generate the 2-KHz super frame sync interrupt. The SFSC block then divides
this accordingly. When P1CR[FSM] is set, FSC1 is the source of the super frame sync. In
case P1CR[MS] is 0 (that is, port 1 is in slave mode), the interrupt is ultimately driven by
an external source. In case the M/S bit is 1 (that is, port 1 is in master mode), FSC1
ultimately comes from port 0.
相關PDF資料 |
PDF描述 |
|---|---|
| MCF5407 | ColdFire Integrated Microprocessor(ColdFire微處理器) |
| MCM101524 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B12 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B15 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101525 | 2M x 2 Bit Fast Static Random Access Memory with ECL I/O |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MCF5272CVF66 | 功能描述:微處理器 - MPU 66MHz 63MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5272CVF66J | 功能描述:32位微控制器 - MCU V2CORE 4KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數據總線寬度:32 bit 最大時鐘頻率:90 MHz 程序存儲器大小:64 KB 數據 RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風格:SMD/SMT |
| MCF5272CVM66 | 功能描述:微處理器 - MPU 66MHz 63MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數據總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數據 RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5272CVM66J | 功能描述:32位微控制器 - MCU V2CORE 4KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數據總線寬度:32 bit 最大時鐘頻率:90 MHz 程序存儲器大小:64 KB 數據 RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風格:SMD/SMT |
| MCF5272CVM66J | 制造商:Freescale Semiconductor 功能描述:IC MCU 32-BIT 66MHZ MAPBGA-196 |
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