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參數(shù)資料
| 型號： | MCF5272 |
| 廠商： | Motorola, Inc. |
| 英文描述： | MCF5272 ColdFire Integrated Microprocessor Users Manual |
| 中文描述： | MCF5272的ColdFire集成式微處理器用戶手冊 |
| 文件頁數(shù)： | 485/550頁 |
| 文件大小： | 6709K |
| 代理商： | MCF5272 |
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MOTOROLA
Chapter 21. IEEE 1149.1 Test Access Port (JTAG)
21-3
TAP Controller
21.3 TAP Controller
The TAP controller is a synchronous state machine that controls JTAG logic and interprets
the sequence of logical values on TMS. The value adjacent to each arrow in the state
machine in Figure 21-2 re
fl
ects the value of TMS sampled on the rising edge of TCK. For
a description of the TAP controller states, refer to the IEEE 1149.1 document.
Table 21-1. JTAG Signals
Signal
Description
TCK/
PSTCLK
Test clock. TCK is the dedicated JTAG test logic clock input, independent of the CPU system clock. It
provides a clock for on-board test logic de
fi
ned by the IEEE 1149.1 standard. TCK should be grounded if
the JTAG port is not used and MTMOD is tied low.
TMS/
BKPT
Test mode select. This input controls test mode operations for on-board test logic de
fi
ned by the IEEE
1149.1 standard. Connecting TMS to VDD disables the test controller, making all JTAG circuits
transparent to the system.
TDO/
DSO
Test and debug data out. Output for shifting data out of serial data port logic. Shifting out data depends on
the state of the JTAG controller state machine and the instructions in the instruction register. The shift
occurs on the falling edge of TCK. When not outputting data, TDO is placed in high-impedance state.
TDO can also be three-stated to allow bused or parallel connections to other devices having JTAG test
access ports.
TDI/DSI
Test and debug data in. Input provided for loading serial data port shift registers (boundary-scan, bypass,
and instruction registers). Shifting in of data depends on the state of the JTAG controller state machine
and the instruction currently in the instruction register. Data is shifted in on the rising edge of TCK.
TRST/
DSCLK
JTAG test reset. TRST asynchronously resets the JTAG TAP logic when low.
MTMOD
Motorola test mode select. Negating MTMOD enables JTAG mode; asserting it enables BDM mode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCF5407 | ColdFire Integrated Microprocessor(ColdFire微處理器) |
| MCM101524 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B12 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B15 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101525 | 2M x 2 Bit Fast Static Random Access Memory with ECL I/O |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5272CVF66 | 功能描述:微處理器 - MPU 66MHz 63MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5272CVF66J | 功能描述:32位微控制器 - MCU V2CORE 4KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:90 MHz 程序存儲器大小:64 KB 數(shù)據(jù) RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風(fēng)格:SMD/SMT |
| MCF5272CVM66 | 功能描述:微處理器 - MPU 66MHz 63MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5272CVM66J | 功能描述:32位微控制器 - MCU V2CORE 4KSRAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:90 MHz 程序存儲器大小:64 KB 數(shù)據(jù) RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風(fēng)格:SMD/SMT |
| MCF5272CVM66J | 制造商:Freescale Semiconductor 功能描述:IC MCU 32-BIT 66MHZ MAPBGA-196 |
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