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參數(shù)資料
| 型號： | MCF5272 |
| 廠商： | Motorola, Inc. |
| 英文描述： | MCF5272 ColdFire Integrated Microprocessor Users Manual |
| 中文描述： | MCF5272的ColdFire集成式微處理器用戶手冊 |
| 文件頁數(shù)： | 411/550頁 |
| 文件大小： | 6709K |
| 代理商： | MCF5272 |
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MOTOROLA
Chapter 18. Pulse Width Modulation (PWM) Module
18-3
PWM Programming Model
18.3.1 PWM Control Register (PWCR
n
)
This register, shown in Figure 18-2, controls the overall operation of the PWM. Unless
disabled and then re-enabled, writing to PWCR while the PWM is running will not alter its
operation until the current output cycle
fi
nishes. For example, if the prescale value is
changed while the PWM is enabled, the new value will not take effect until after the counter
has “wrapped around”. The PWM must be disabled and then re-enabled to affect its
operation before the end of the current output cycle.
Figure 18-2. PWM Control Registers (PWCR
n
)
Table 18-2 gives PWCR
fi
eld descriptions.
7
6
5
4
3
0
Field
EN
FRC1
LVL
—
CKSEL
Reset
0010_0000
R/W
Read/Write
Address
MBAR + 0x0C0 (PWCR0); + 0x0C4 (PWCR1); + 0x0C8 (PWCR2)
Table 18-2. PWCR
n
Field Descriptions
Bits
Name
Description
7
EN
Enable.
0 Disables the PWM. While disabled, the PWM is in low-power mode and the prescaler
does not count. When the PWM is disabled, the output is forced to the value of
PWCRn[LVL].
1 Enables the PWM.
6
FRC1
Force output high.
0 Default reset value. PWM functions normally.
1 The PWM drives the output high for the entire counter period. PWCRn[FRC1] has a
lower priority than PWCRn[EN], so setting PWCRn[FRC1] while PWCRn[EN] is
cleared has no effect. There are two ways to drive the PWM output high. If PWCRn[EN]
is cleared, PWM output immediately assumes the value of PWCRn[LVL]. If
PWCRn[FRC1] is set while PWCRn[EN] is set, the PWM output does not go high until
after the current output cycle completes.
5
LVL
Disable level. Determines the PWM output level whenever the PWM is disabled.
0 The PWM output is low while disabled.
1 The PWM output is high while disabled.
4
—
Reserved, should be cleared.
3–0
CKSL
Prescale clock. These bits select the clock frequency divider, that is, the output of the
divider chain, as shown below.
CKSL[3:0] Divisor
0000
1
0001
2
0010
4
...
...
1111
32768
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCF5407 | ColdFire Integrated Microprocessor(ColdFire微處理器) |
| MCM101524 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B12 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101524B15 | 1M x 4 Bit Fast Static Random Access Memory with ECL I/O |
| MCM101525 | 2M x 2 Bit Fast Static Random Access Memory with ECL I/O |
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參數(shù)描述 |
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| MCF5272CVM66J | 制造商:Freescale Semiconductor 功能描述:IC MCU 32-BIT 66MHZ MAPBGA-196 |
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